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This driver is made for it82xx2 series. Signed-off-by: Tim Lin <tim2.lin@ite.corp-partner.google.com>pull/57017/head
Tim Lin
3 years ago
committed by
Anas Nashif
6 changed files with 1080 additions and 0 deletions
@ -0,0 +1,456 @@ |
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/*
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* Copyright (c) 2023 ITE Corporation. All Rights Reserved. |
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* |
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* SPDX-License-Identifier: Apache-2.0 |
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* |
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*/ |
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#define DT_DRV_COMPAT ite_it8xxx2_gpio_v2 |
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#include <errno.h> |
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#include <soc.h> |
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#include <soc_dt.h> |
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#include <string.h> |
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#include <zephyr/device.h> |
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#include <zephyr/drivers/gpio.h> |
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#include <zephyr/drivers/gpio/gpio_utils.h> |
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|
#include <zephyr/dt-bindings/gpio/ite-it8xxx2-gpio.h> |
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|
#include <zephyr/dt-bindings/interrupt-controller/ite-intc.h> |
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#include <zephyr/irq.h> |
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#include <zephyr/sys/util.h> |
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#include <zephyr/types.h> |
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#include <zephyr/logging/log.h> |
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LOG_MODULE_REGISTER(gpio_it8xxx2, LOG_LEVEL_ERR); |
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/*
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* Structure gpio_ite_cfg is about the setting of GPIO |
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* this config will be used at initial time |
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*/ |
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struct gpio_ite_cfg { |
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/* gpio_driver_config needs to be first */ |
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struct gpio_driver_config common; |
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/* GPIO port data register (bit mapping to pin) */ |
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uintptr_t reg_gpdr; |
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/* GPIO port data mirror register (bit mapping to pin) */ |
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uintptr_t reg_gpdmr; |
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/* GPIO port output type register (bit mapping to pin) */ |
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uintptr_t reg_gpotr; |
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/* GPIO port 1.8V select register (bit mapping to pin) */ |
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uintptr_t reg_p18scr; |
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/* GPIO port control register (byte mapping to pin) */ |
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uintptr_t reg_gpcr; |
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/* Wake up control base register */ |
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uintptr_t wuc_base[8]; |
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/* Wake up control mask */ |
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uint8_t wuc_mask[8]; |
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/* GPIO's irq */ |
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uint8_t gpio_irq[8]; |
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/* Support input voltage selection */ |
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uint8_t has_volt_sel[8]; |
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/* Number of pins per group of GPIO */ |
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uint8_t num_pins; |
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}; |
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/* Structure gpio_ite_data is about callback function */ |
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|
struct gpio_ite_data { |
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|
struct gpio_driver_data common; |
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|
sys_slist_t callbacks; |
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|
uint8_t volt_default_set; |
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|
}; |
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|
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|
/**
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|
* Driver functions |
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*/ |
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static int gpio_ite_configure(const struct device *dev, |
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|
gpio_pin_t pin, |
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gpio_flags_t flags) |
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|
{ |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
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|
volatile uint8_t *reg_gpdr = (uint8_t *)gpio_config->reg_gpdr; |
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|
volatile uint8_t *reg_gpotr = (uint8_t *)gpio_config->reg_gpotr; |
||||||
|
volatile uint8_t *reg_p18scr = (uint8_t *)gpio_config->reg_p18scr; |
||||||
|
volatile uint8_t *reg_gpcr = (uint8_t *)gpio_config->reg_gpcr + pin; |
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|
struct gpio_ite_data *data = dev->data; |
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|
uint8_t mask = BIT(pin); |
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|
/* Don't support "open source" mode */ |
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|
if (((flags & GPIO_SINGLE_ENDED) != 0) && |
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|
((flags & GPIO_LINE_OPEN_DRAIN) == 0)) { |
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|
return -ENOTSUP; |
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} |
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|
if (flags == GPIO_DISCONNECTED) { |
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|
*reg_gpcr = GPCR_PORT_PIN_MODE_TRISTATE; |
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|
/*
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|
* Since not all GPIOs can be to configured as tri-state, |
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|
* prompt error if pin doesn't support the flag. |
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|
*/ |
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if (*reg_gpcr != GPCR_PORT_PIN_MODE_TRISTATE) { |
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|
/* Go back to default setting (input) */ |
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|
*reg_gpcr = GPCR_PORT_PIN_MODE_INPUT; |
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|
LOG_ERR("Cannot config the node-gpio@%x, pin=%d as tri-state", |
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|
(uint32_t)reg_gpdr, pin); |
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|
return -ENOTSUP; |
||||||
|
} |
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|
/*
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|
* The following configuration isn't necessary because the pin |
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|
* was configured as disconnected. |
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*/ |
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return 0; |
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|
} |
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|
/*
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|
* Select open drain first, so that we don't glitch the signal |
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|
* when changing the line to an output. |
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|
*/ |
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|
if (flags & GPIO_OPEN_DRAIN) { |
||||||
|
*reg_gpotr |= mask; |
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|
} else { |
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|
*reg_gpotr &= ~mask; |
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|
} |
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|
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|
/* 1.8V or 3.3V */ |
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|
if (gpio_config->has_volt_sel[pin]) { |
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|
gpio_flags_t volt = flags & IT8XXX2_GPIO_VOLTAGE_MASK; |
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|
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|
if (volt == IT8XXX2_GPIO_VOLTAGE_1P8) { |
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|
__ASSERT(!(flags & GPIO_PULL_UP), |
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|
"Don't enable internal pullup if 1.8V voltage is used"); |
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|
*reg_p18scr |= mask; |
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|
data->volt_default_set &= ~mask; |
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|
} else if (volt == IT8XXX2_GPIO_VOLTAGE_3P3) { |
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|
*reg_p18scr &= ~mask; |
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|
/*
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|
* A variable is needed to store the difference between |
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|
* 3.3V and default so that the flag can be distinguished |
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|
* between the two in gpio_ite_get_config. |
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*/ |
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|
data->volt_default_set &= ~mask; |
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|
} else if (volt == IT8XXX2_GPIO_VOLTAGE_DEFAULT) { |
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|
*reg_p18scr &= ~mask; |
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|
data->volt_default_set |= mask; |
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|
} else { |
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|
return -EINVAL; |
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} |
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} |
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|
/* If output, set level before changing type to an output. */ |
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|
if (flags & GPIO_OUTPUT) { |
||||||
|
if (flags & GPIO_OUTPUT_INIT_HIGH) { |
||||||
|
*reg_gpdr |= mask; |
||||||
|
} else if (flags & GPIO_OUTPUT_INIT_LOW) { |
||||||
|
*reg_gpdr &= ~mask; |
||||||
|
} |
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|
} |
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|
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|
/* Set input or output. */ |
||||||
|
if (flags & GPIO_OUTPUT) { |
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|
*reg_gpcr = (*reg_gpcr | GPCR_PORT_PIN_MODE_OUTPUT) & |
||||||
|
~GPCR_PORT_PIN_MODE_INPUT; |
||||||
|
} else { |
||||||
|
*reg_gpcr = (*reg_gpcr | GPCR_PORT_PIN_MODE_INPUT) & |
||||||
|
~GPCR_PORT_PIN_MODE_OUTPUT; |
||||||
|
} |
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|
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|
/* Handle pullup / pulldown */ |
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|
if (flags & GPIO_PULL_UP) { |
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|
*reg_gpcr = (*reg_gpcr | GPCR_PORT_PIN_MODE_PULLUP) & |
||||||
|
~GPCR_PORT_PIN_MODE_PULLDOWN; |
||||||
|
} else if (flags & GPIO_PULL_DOWN) { |
||||||
|
*reg_gpcr = (*reg_gpcr | GPCR_PORT_PIN_MODE_PULLDOWN) & |
||||||
|
~GPCR_PORT_PIN_MODE_PULLUP; |
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|
} else { |
||||||
|
/* No pull up/down */ |
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|
*reg_gpcr &= ~(GPCR_PORT_PIN_MODE_PULLUP | |
||||||
|
GPCR_PORT_PIN_MODE_PULLDOWN); |
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|
} |
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|
return 0; |
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} |
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#ifdef CONFIG_GPIO_GET_CONFIG |
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|
static int gpio_ite_get_config(const struct device *dev, |
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|
gpio_pin_t pin, |
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|
gpio_flags_t *out_flags) |
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{ |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
||||||
|
volatile uint8_t *reg_gpdr = (uint8_t *)gpio_config->reg_gpdr; |
||||||
|
volatile uint8_t *reg_gpotr = (uint8_t *)gpio_config->reg_gpotr; |
||||||
|
volatile uint8_t *reg_p18scr = (uint8_t *)gpio_config->reg_p18scr; |
||||||
|
volatile uint8_t *reg_gpcr = (uint8_t *)gpio_config->reg_gpcr + pin; |
||||||
|
struct gpio_ite_data *data = dev->data; |
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|
uint8_t mask = BIT(pin); |
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|
gpio_flags_t flags = 0; |
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|
/* push-pull or open-drain */ |
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|
if (*reg_gpotr & mask) { |
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|
flags |= GPIO_OPEN_DRAIN; |
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|
} |
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|
/* 1.8V or 3.3V */ |
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|
if (gpio_config->has_volt_sel[pin]) { |
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|
if (data->volt_default_set & mask) { |
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|
flags |= IT8XXX2_GPIO_VOLTAGE_DEFAULT; |
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|
} else { |
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|
if (*reg_p18scr & mask) { |
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|
flags |= IT8XXX2_GPIO_VOLTAGE_1P8; |
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|
} else { |
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|
flags |= IT8XXX2_GPIO_VOLTAGE_3P3; |
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|
} |
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|
} |
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|
} |
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|
|
||||||
|
/* set input or output. */ |
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|
if (*reg_gpcr & GPCR_PORT_PIN_MODE_OUTPUT) { |
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|
flags |= GPIO_OUTPUT; |
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|
/* set level */ |
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|
if (*reg_gpdr & mask) { |
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|
flags |= GPIO_OUTPUT_HIGH; |
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} else { |
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flags |= GPIO_OUTPUT_LOW; |
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} |
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|
} |
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|
if (*reg_gpcr & GPCR_PORT_PIN_MODE_INPUT) { |
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|
flags |= GPIO_INPUT; |
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|
/* pullup / pulldown */ |
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|
if (*reg_gpcr & GPCR_PORT_PIN_MODE_PULLUP) { |
||||||
|
flags |= GPIO_PULL_UP; |
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|
} |
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|
|
||||||
|
if (*reg_gpcr & GPCR_PORT_PIN_MODE_PULLDOWN) { |
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|
flags |= GPIO_PULL_DOWN; |
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|
} |
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|
} |
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|
|
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|
*out_flags = flags; |
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|
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|
return 0; |
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|
} |
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|
#endif |
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|
static int gpio_ite_port_get_raw(const struct device *dev, |
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|
gpio_port_value_t *value) |
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|
{ |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
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|
volatile uint8_t *reg_gpdmr = (uint8_t *)gpio_config->reg_gpdmr; |
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|
|
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|
/* Get raw bits of GPIO mirror register */ |
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|
*value = *reg_gpdmr; |
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|
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|
return 0; |
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|
} |
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|
static int gpio_ite_port_set_masked_raw(const struct device *dev, |
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|
gpio_port_pins_t mask, |
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|
gpio_port_value_t value) |
||||||
|
{ |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
||||||
|
volatile uint8_t *reg_gpdr = (uint8_t *)gpio_config->reg_gpdr; |
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|
uint8_t out = *reg_gpdr; |
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|
|
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|
*reg_gpdr = ((out & ~mask) | (value & mask)); |
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|
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|
return 0; |
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|
} |
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|
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|
static int gpio_ite_port_set_bits_raw(const struct device *dev, |
||||||
|
gpio_port_pins_t pins) |
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|
{ |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
||||||
|
volatile uint8_t *reg_gpdr = (uint8_t *)gpio_config->reg_gpdr; |
||||||
|
|
||||||
|
/* Set raw bits of GPIO data register */ |
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|
*reg_gpdr |= pins; |
||||||
|
|
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|
return 0; |
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|
} |
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|
|
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|
static int gpio_ite_port_clear_bits_raw(const struct device *dev, |
||||||
|
gpio_port_pins_t pins) |
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|
{ |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
||||||
|
volatile uint8_t *reg_gpdr = (uint8_t *)gpio_config->reg_gpdr; |
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|
|
||||||
|
/* Clear raw bits of GPIO data register */ |
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|
*reg_gpdr &= ~pins; |
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|
|
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|
return 0; |
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|
} |
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|
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|
static int gpio_ite_port_toggle_bits(const struct device *dev, |
||||||
|
gpio_port_pins_t pins) |
||||||
|
{ |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
||||||
|
volatile uint8_t *reg_gpdr = (uint8_t *)gpio_config->reg_gpdr; |
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|
|
||||||
|
/* Toggle raw bits of GPIO data register */ |
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|
*reg_gpdr ^= pins; |
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return 0; |
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} |
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|
static int gpio_ite_manage_callback(const struct device *dev, |
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|
struct gpio_callback *callback, |
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bool set) |
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{ |
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|
struct gpio_ite_data *data = dev->data; |
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|
return gpio_manage_callback(&data->callbacks, callback, set); |
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} |
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static void gpio_ite_isr(const void *arg) |
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{ |
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|
const struct device *dev = arg; |
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|
const struct gpio_ite_cfg *gpio_config = dev->config; |
||||||
|
struct gpio_ite_data *data = dev->data; |
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|
uint8_t irq = ite_intc_get_irq_num(); |
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|
uint8_t num_pins = gpio_config->num_pins; |
||||||
|
uint8_t pin; |
||||||
|
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||||||
|
for (pin = 0; pin <= num_pins; pin++) { |
||||||
|
if (irq == gpio_config->gpio_irq[pin]) { |
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|
volatile uint8_t *reg_base = |
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|
(uint8_t *)gpio_config->wuc_base[pin]; |
||||||
|
volatile uint8_t *reg_wuesr = reg_base + 1; |
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|
uint8_t wuc_mask = gpio_config->wuc_mask[pin]; |
||||||
|
|
||||||
|
/* Clear the WUC status register. */ |
||||||
|
*reg_wuesr = wuc_mask; |
||||||
|
gpio_fire_callbacks(&data->callbacks, dev, BIT(pin)); |
||||||
|
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||||||
|
break; |
||||||
|
} |
||||||
|
} |
||||||
|
} |
||||||
|
|
||||||
|
static int gpio_ite_pin_interrupt_configure(const struct device *dev, |
||||||
|
gpio_pin_t pin, |
||||||
|
enum gpio_int_mode mode, |
||||||
|
enum gpio_int_trig trig) |
||||||
|
{ |
||||||
|
const struct gpio_ite_cfg *gpio_config = dev->config; |
||||||
|
uint8_t gpio_irq = gpio_config->gpio_irq[pin]; |
||||||
|
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||||||
|
#ifdef CONFIG_GPIO_ENABLE_DISABLE_INTERRUPT |
||||||
|
if (mode == GPIO_INT_MODE_DISABLED || mode == GPIO_INT_MODE_DISABLE_ONLY) { |
||||||
|
#else |
||||||
|
if (mode == GPIO_INT_MODE_DISABLED) { |
||||||
|
#endif /* CONFIG_GPIO_ENABLE_DISABLE_INTERRUPT */ |
||||||
|
/* Disable GPIO interrupt */ |
||||||
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irq_disable(gpio_irq); |
||||||
|
return 0; |
||||||
|
#ifdef CONFIG_GPIO_ENABLE_DISABLE_INTERRUPT |
||||||
|
} else if (mode == GPIO_INT_MODE_ENABLE_ONLY) { |
||||||
|
/* Only enable GPIO interrupt */ |
||||||
|
irq_enable(gpio_irq); |
||||||
|
return 0; |
||||||
|
#endif /* CONFIG_GPIO_ENABLE_DISABLE_INTERRUPT */ |
||||||
|
} |
||||||
|
|
||||||
|
if (mode == GPIO_INT_MODE_LEVEL) { |
||||||
|
LOG_ERR("Level trigger mode not supported"); |
||||||
|
return -ENOTSUP; |
||||||
|
} |
||||||
|
|
||||||
|
/* Disable irq before configuring it */ |
||||||
|
irq_disable(gpio_irq); |
||||||
|
|
||||||
|
if (trig & GPIO_INT_TRIG_BOTH) { |
||||||
|
volatile uint8_t *reg_base = (uint8_t *)gpio_config->wuc_base[pin]; |
||||||
|
volatile uint8_t *reg_wuemr = reg_base; |
||||||
|
volatile uint8_t *reg_wuesr = reg_base + 1; |
||||||
|
volatile uint8_t *reg_wubemr = reg_base + 3; |
||||||
|
uint8_t wuc_mask = gpio_config->wuc_mask[pin]; |
||||||
|
|
||||||
|
/* Set both edges interrupt. */ |
||||||
|
if ((trig & GPIO_INT_TRIG_BOTH) == GPIO_INT_TRIG_BOTH) { |
||||||
|
*reg_wubemr |= wuc_mask; |
||||||
|
} else { |
||||||
|
*reg_wubemr &= ~wuc_mask; |
||||||
|
} |
||||||
|
|
||||||
|
if (trig & GPIO_INT_TRIG_LOW) { |
||||||
|
*reg_wuemr |= wuc_mask; |
||||||
|
} else { |
||||||
|
*reg_wuemr &= ~wuc_mask; |
||||||
|
} |
||||||
|
/*
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||||||
|
* Always write 1 to clear the WUC status register after |
||||||
|
* modifying edge mode selection register (WUBEMR and WUEMR). |
||||||
|
*/ |
||||||
|
*reg_wuesr = wuc_mask; |
||||||
|
} |
||||||
|
|
||||||
|
/* Enable GPIO interrupt */ |
||||||
|
irq_connect_dynamic(gpio_irq, 0, gpio_ite_isr, dev, 0); |
||||||
|
irq_enable(gpio_irq); |
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|
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||||||
|
return 0; |
||||||
|
} |
||||||
|
|
||||||
|
static const struct gpio_driver_api gpio_ite_driver_api = { |
||||||
|
.pin_configure = gpio_ite_configure, |
||||||
|
#ifdef CONFIG_GPIO_GET_CONFIG |
||||||
|
.pin_get_config = gpio_ite_get_config, |
||||||
|
#endif |
||||||
|
.port_get_raw = gpio_ite_port_get_raw, |
||||||
|
.port_set_masked_raw = gpio_ite_port_set_masked_raw, |
||||||
|
.port_set_bits_raw = gpio_ite_port_set_bits_raw, |
||||||
|
.port_clear_bits_raw = gpio_ite_port_clear_bits_raw, |
||||||
|
.port_toggle_bits = gpio_ite_port_toggle_bits, |
||||||
|
.pin_interrupt_configure = gpio_ite_pin_interrupt_configure, |
||||||
|
.manage_callback = gpio_ite_manage_callback, |
||||||
|
}; |
||||||
|
|
||||||
|
static int gpio_ite_init(const struct device *dev) |
||||||
|
{ |
||||||
|
return 0; |
||||||
|
} |
||||||
|
|
||||||
|
#define GPIO_ITE_DEV_CFG_DATA(inst) \ |
||||||
|
static struct gpio_ite_data gpio_ite_data_##inst; \ |
||||||
|
static const struct gpio_ite_cfg gpio_ite_cfg_##inst = { \ |
||||||
|
.common = { \ |
||||||
|
.port_pin_mask = \ |
||||||
|
GPIO_PORT_PIN_MASK_FROM_DT_INST(inst) \ |
||||||
|
}, \ |
||||||
|
.reg_gpdr = DT_INST_REG_ADDR_BY_IDX(inst, 0), \ |
||||||
|
.reg_gpdmr = DT_INST_REG_ADDR_BY_IDX(inst, 1), \ |
||||||
|
.reg_gpotr = DT_INST_REG_ADDR_BY_IDX(inst, 2), \ |
||||||
|
.reg_p18scr = DT_INST_REG_ADDR_BY_IDX(inst, 3), \ |
||||||
|
.reg_gpcr = DT_INST_REG_ADDR_BY_IDX(inst, 4), \ |
||||||
|
.wuc_base = DT_INST_PROP_OR(inst, wuc_base, {0}), \ |
||||||
|
.wuc_mask = DT_INST_PROP_OR(inst, wuc_mask, {0}), \ |
||||||
|
.gpio_irq = IT8XXX2_DT_GPIO_IRQ_LIST(inst), \ |
||||||
|
.has_volt_sel = DT_INST_PROP_OR(inst, has_volt_sel, {0}), \ |
||||||
|
.num_pins = DT_INST_PROP(inst, ngpios), \ |
||||||
|
}; \ |
||||||
|
DEVICE_DT_INST_DEFINE(inst, \ |
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|
gpio_ite_init, \ |
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NULL, \ |
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&gpio_ite_data_##inst, \ |
||||||
|
&gpio_ite_cfg_##inst, \ |
||||||
|
PRE_KERNEL_1, \ |
||||||
|
CONFIG_GPIO_INIT_PRIORITY, \ |
||||||
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&gpio_ite_driver_api); |
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|
DT_INST_FOREACH_STATUS_OKAY(GPIO_ITE_DEV_CFG_DATA) |
||||||
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static int gpio_it8xxx2_init_set(void) |
||||||
|
{ |
||||||
|
if (IS_ENABLED(CONFIG_SOC_IT8XXX2_GPIO_GROUP_K_L_DEFAULT_PULL_DOWN)) { |
||||||
|
const struct device *const gpiok = DEVICE_DT_GET(DT_NODELABEL(gpiok)); |
||||||
|
const struct device *const gpiol = DEVICE_DT_GET(DT_NODELABEL(gpiol)); |
||||||
|
|
||||||
|
for (int i = 0; i < 8; i++) { |
||||||
|
gpio_pin_configure(gpiok, i, GPIO_INPUT | GPIO_PULL_DOWN); |
||||||
|
gpio_pin_configure(gpiol, i, GPIO_INPUT | GPIO_PULL_DOWN); |
||||||
|
} |
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|
} |
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|
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|
return 0; |
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|
} |
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|
SYS_INIT(gpio_it8xxx2_init_set, PRE_KERNEL_1, CONFIG_GPIO_INIT_PRIORITY); |
||||||
@ -0,0 +1,32 @@ |
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# Copyright (c) 2023 ITE Corporation. All Rights Reserved. |
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|
# SPDX-License-Identifier: Apache-2.0 |
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description: This binding gives a base representation of the ITE gpio |
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compatible: "ite,it8xxx2-gpio-v2" |
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include: [gpio-controller.yaml, base.yaml] |
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properties: |
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reg: |
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required: true |
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has-volt-sel: |
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type: array |
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description: | |
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Selection of support input voltage 3.3V or 1.8V. |
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wuc-base: |
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type: array |
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description: | |
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WUCs are mapped to the pins of GPIO. |
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The WUC groups internal and external inputs, and asserts |
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a wake-up signal to the INTC, allowing the CPU to exit |
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|
Doze/Deep Doze/Sleep modes. |
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wuc-mask: |
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type: array |
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gpio-cells: |
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- pin |
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- flags |
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